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Cadence ChipStack AI Super Agent

Cadence AI for Design
Cadence AI-driven Verification
Cadence Tools list

全球首个用于芯片设计与验证的Agentic AI

Cadence 于 2026年2月10日 正式推出 ChipStack AI Super Agent，这是全球首个基于 agentic AI（代理式AI） 的芯片前端设计与验证自动化工作流。它能从芯片规格书和高层次描述出发，自主生成RTL代码、测试台、验证计划、执行测试、调试失败并自动修复，实现最高 10X 的生产力提升，已被NVIDIA、Altera、Tenstorrent和Qualcomm等顶级公司早期采用。

ChipStack AI Super Agent End-to-End Agentic AI Verification

产品背景​

ChipStack 源于Cadence在 2025年11月 收购的同名AI初创公司（总部西雅图），该公司专注于AI驱动的芯片验证自动化。Cadence将其技术深度整合到自家EDA工具链中，形成完整的产品。

ChipStack AI Super Agent 是Cadence “AI-for-Design”战略的核心成果，结合了生成式AI、优化AI和助手式AI，目标是应对芯片复杂度爆炸式增长（异构计算、IP复用、先进封装）和高级工程师人才短缺问题。

核心技术与工作原理​

ChipStack 不是简单的生成式AI助手（如Copilot），而是一个超级代理（Super Agent），由多个子代理（虚拟工程师）协同组成，像一个AI工程团队自主工作。

关键概念​

  • Mental Model（心理模型） → 结构化表示整个设计意图（规格、层次结构、依赖关系、代码、行为），作为“单一真相来源”，防止LLM幻觉，确保生成内容准确可靠。
  • Agentic Workflow（代理式工作流） → 代理自主调用Cadence底层EDA工具（如Verisium验证平台、Cerebrus智能优化引擎、JedAI数据平台），执行多步骤推理和迭代。
  • 人类在循环（Human-in-the-Loop） → 工程师可随时干预、指导或审批，像资深工程师带新人。

主要子代理示例​

子代理类型主要职责
IP设计代理从规格生成RTL代码和模块
验证代理生成测试计划、测试台、覆盖率分析
SoC集成代理系统级集成、接口协调
调试代理分析失败、读取波形/日志、提出修复方案
回归/测试协调代理自动运行回归测试、优化测试序列

支持的大模型​

支持NVIDIA Nemotron（可定制）、OpenAI GPT等，可在云、混合或本地部署（支持Tenstorrent硬件高性能推理）。

主要功能与加速效果​

ChipStack 覆盖芯片前端全流程自动化：

  • 设计阶段 — 从自然语言规格/文档/图表自动生成RTL代码和设计层次。
  • 验证阶段 — 自动创建测试计划、测试台、运行模拟/形式验证、分析覆盖率。
  • 调试与迭代 — 读取仿真日志/波形、定位根因、提出并应用修复，迭代直到通过。
  • 整体工作流 — 端到端协调，从规格到可验证设计，任务从“几天/几周”缩短到“几小时/当天”。

加速实测​

  • 某些任务最高10X（如RTL编码、测试台生成、调试）。
  • 形式验证周期从数周缩短到数小时（Tenstorrent实测最高4X）。
  • 整体验证努力减少约10X（Altera报告）。
  • Demo示例：一个典型全天验证工作流，在20分钟内完成。

The Foundation of Everything: The Mental Model

客户反馈与早期采用​

多家头部公司已进入早期部署/评估阶段：

  • Altera → “在某些领域验证努力减少约10X，实现更快闭合和更深覆盖率。”（Arvind Vidyarthi）
  • Tenstorrent → “三个关键模块评估中，验证时间最高缩短4X，并在自家硬件上高效运行。”（Daniel Cummings）
  • NVIDIA → “结合Mental Model和自动化测试计划生成，与NVIDIA加速计算结合，可解锁新级别生产力。”（Timothy Costa）
  • Qualcomm → 早期结果显示显著性能提升，期待大规模生产力收益。（Paul Penzes）

这些反馈表明，ChipStack已在真实复杂设计中验证有效。

与传统/竞品工具的区别​

传统EDA工具依赖人工手动操作，AI助手（如Synopsys.ai Copilot）仅提供建议。ChipStack实现自主多代理协作，从单步加速进化到全流程自动化，真正像“AI工程师团队”独立工作，同时保持确定性（底层EDA工具确保准确性）。

当前状态与获取方式​

未来展望：官方表示，这是通向“全自主芯片设计”的第一步，未来将扩展到后端（布局布线、物理实现）等领域。